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常见问答

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使用下列指令初始化系统时钟源时，为什么HCLK的时钟源无法切换成PLL? CLK->CLKSEL0 = (CLK->CLKSEL0 & ~CLK_CLKSEL0_HCLKSEL_Msk); CLK->CLKSEL0 |= CLK_CLKSEL0_HCLKSEL_PLL;  日期：2016-12-01

问：使用下列指令初始化系统时钟源时，为什么HCLK的时钟源无法切换成PLL?
CLK->CLKSEL0 = (CLK->CLKSEL0 & ~CLK_CLKSEL0_HCLKSEL_Msk);
CLK->CLKSEL0 |= CLK_CLKSEL0_HCLKSEL_PLL;

答：在执行第一行指令

CLK->CLKSEL0 = (CLK->CLKSEL0 & ~CLK_CLKSEL0_HCLKSEL_Msk);

时，HCLKSEL (CLKSEL0[2:0])将设为0x00。当HCLKSEL设为0x00时，如下图所示，将切换HCLK的时钟源为外部晶振。

 

如果此时外部晶振没有稳定或使能，这时切换时钟源会失败，HCLKSEL将保持原本设定 (初始为0x07，时钟源为HIRC)。

因此在执行第二行指令

CLK->CLKSEL0 |= CLK_CLKSEL0_HCLKSEL_PLL;

时，HCLKSEL无法正确设为PLL，HCLK无法切换成PLL。

用户在切换时钟源时，需要确认要切换的时钟源已经稳定。建议使用以下方法切换时钟源：
 

1、直接写值

CLK->CLKSEL0 = (CLK->CLKSEL0 & ~CLK_CLKSEL0_HCLKSEL_Msk) | CLK_CLKSEL0_HCLKSEL_PLL;
 

2、调用函数

CLK_SetHCLK(CLK_CLKSEL0_HCLKSEL_PLL, CLK_CLKDIV_HCLK(2));

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